Icarus Verilog Verilog सिमुलेशन और संश्लेषण उपकरण
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अनुकरण संकलन वेरिलॉग सिम्युलेटर Verilog Verilog संकलक Verilog संश्लेषण

Icarus Verilog विवरण

Verilog सिमुलेशन और संश्लेषण उपकरण Icarus Verilog एक Verilog सिमुलेशन और संश्लेषण उपकरण है। यह एक कंपाइलर के रूप में संचालित होता है, जो कुछ लक्ष्य प्रारूप में verilog (आईईईई -1364) में स्रोत कोड लिखने के लिए संचालित होता है। बैच सिमुलेशन के लिए, कंपाइलर वीवीपी असेंबली नामक एक मध्यवर्ती रूप उत्पन्न कर सकता है। यह इंटरमीडिएट फॉर्म `` vvp 'कमांड द्वारा निष्पादित किया जाता है। संश्लेषण के लिए, कंपाइलर वांछित प्रारूप में नेटलिस्ट उत्पन्न करता है। कंपाइलर उचित है कि आईईईई मानक आईईईई एसटीडी 1364-2001 को लिखे गए डिज़ाइन विवरणों को विस्तृत और पार्स करने का इरादा है। मानक उचित वर्ष 2001 के मध्य में जारी किया गया था, हालांकि एक विशेष रूप से मूल्यवान इलेक्ट्रॉनिक रूप में। यह काफी बड़ा और जटिल मानक है, इसलिए वहां पहुंचने में कुछ समय लगेगा, लेकिन यह लक्ष्य है। नोट: iCarus Verilog एक काम प्रगति पर है, और चूंकि भाषा मानक अभी भी खड़े नहीं है, शायद यह हमेशा होगा।

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